問(wèn)：LoRaWAN數(shù)據(jù)速率是多少?
答：對(duì)于LoRa來(lái)說(shuō)，LoRaWAN數(shù)據(jù)速率范圍在0.3kbps到11kbps之間，歐洲地區(qū)GFSK數(shù)據(jù)速率是50kbps。在北美地區(qū)，由于FCC限制最小數(shù)據(jù)速率是0.9kbps。為使終端設(shè)備的電池壽命和總體網(wǎng)絡(luò)容量最大化，LoRaWAN網(wǎng)絡(luò)服務(wù)器通過(guò)自適應(yīng)數(shù)據(jù)速率(ADR)算法對(duì)每個(gè)終端設(shè)備數(shù)據(jù)速率和RF輸出分別進(jìn)行管理。ADR對(duì)于高性能網(wǎng)絡(luò)是至關(guān)重要的，具有了可擴(kuò)展性。在基礎(chǔ)設(shè)施方面，以最小的投資部署一個(gè)網(wǎng)絡(luò)，當(dāng)需要增加容量時(shí)，就部署更多的網(wǎng)關(guān)，ADR將會(huì)使數(shù)據(jù)速率更高，可將網(wǎng)絡(luò)容量擴(kuò)展6到8倍。
答：LoRa調(diào)制解調(diào)器對(duì)同信道GMSK干擾抑制可達(dá)19.5dB，或換句話說(shuō)，它可以接受低于干擾信號(hào)或底噪聲的信號(hào)19.5dB。因?yàn)閾碛羞@么強(qiáng)的抗干擾性，所以LoRaTM調(diào)制系統(tǒng)不僅可以用于頻譜使用率較高的頻段，也可以用于混合通訊網(wǎng)絡(luò)，以便在網(wǎng)絡(luò)中原有的調(diào)制方案失敗時(shí)擴(kuò)大覆蓋范圍。
答：在芯片引腳輸出的功率是+20dBm，經(jīng)過(guò)匹配/濾波損耗后在天線后，在天線上功率是+19dBm +/-0.5dB。最大輸出功率在不同的地區(qū)有不同的規(guī)定，LoRaWAN規(guī)范定義了不同地區(qū)不同的輸出功率使鏈路預(yù)算最大化。
答：CAD用于檢測(cè)LoRa信號(hào)的存在，而不是使用一個(gè)接受信號(hào)強(qiáng)度(RSSI)的方法來(lái)識(shí)別是否有信號(hào)存在。它能夠把噪音和需要的LoRa信號(hào)區(qū)分出來(lái)。CAD過(guò)程需要兩個(gè)符號(hào)，如果被CAD檢測(cè)到，CAD_Detected中斷變?yōu)橛行?，設(shè)備處于RX模式接受數(shù)據(jù)有效載荷。
答：+20dBm規(guī)格是對(duì)芯片引腳輸出功率而言。在任何的RF系統(tǒng)中，帶通濾波器和RF開(kāi)關(guān)都有插入損耗的特性，在匹配濾波后天線上典型性能可達(dá)到+19dBm。
答：是的，沒(méi)有問(wèn)題。LoRa設(shè)備通過(guò)簡(jiǎn)單的SPI寄存器寫(xiě)入可以從FSK切換到LoRa(反過(guò)來(lái)也一樣)。對(duì)設(shè)備的性能和可靠性沒(méi)有影響。LoRa設(shè)備按照數(shù)據(jù)手冊(cè)規(guī)定的可以配置或重新配置為任意參數(shù)。
答：理論上， Rs=BW/(2^SF)、DR= SF*( BW/2^SF)*CR，但我們建議你使用Semtech LoRa調(diào)制解調(diào)器計(jì)算器按照不同的配置選型評(píng)估數(shù)據(jù)速率和傳輸時(shí)間。
答：LoRaWAN網(wǎng)關(guān)模塊主要使用了125kHz信號(hào)帶寬設(shè)置，但其他專用協(xié)議可以利用其他的信號(hào)帶寬(BW)設(shè)置。改變BW、SF和CR也就改變了鏈路預(yù)算和傳輸時(shí)間，需要在電池壽命和距離上做個(gè)權(quán)衡。請(qǐng)使用LoRa調(diào)制解調(diào)器計(jì)算器評(píng)估權(quán)衡。
答：首先，在兩個(gè)設(shè)備間檢查由晶振引起的頻率偏移。帶寬(BW)、中心頻率和數(shù)據(jù)速率這些都源自晶振頻率。其次，檢查在兩邊的軟件/固件設(shè)置，確保頻率、帶寬、擴(kuò)頻因子、編碼率和數(shù)據(jù)包結(jié)構(gòu)是一致的。
問(wèn)：在LoRa模式，當(dāng)循環(huán)冗余校驗(yàn)(CRC)使能時(shí)，怎樣可能接受到一個(gè)錯(cuò)誤的數(shù)據(jù)包?
答：在LoRa模式，即使CRC是錯(cuò)誤的，有效載荷也會(huì)添加到FIFO。在取得有效載荷前必須檢查位PayloadCrcError知道它完整性。在顯式報(bào)頭(Explicit Header)模式，有一個(gè)小的可能性一個(gè)假檢測(cè)產(chǎn)生一個(gè)“克隆”數(shù)據(jù)包。
要么錯(cuò)誤的報(bào)頭打開(kāi)CrcOn位，那么有效載荷將會(huì)是錯(cuò)誤的，調(diào)制解調(diào)器將會(huì)將它標(biāo)記作為一個(gè)PayloadCrcError條件，因此數(shù)據(jù)包容易被過(guò)濾掉;要么錯(cuò)誤的報(bào)頭禁止CrcOn位，這種情況該模式認(rèn)為數(shù)據(jù)包是好的。這些偶然的壞包會(huì)有一個(gè)隨機(jī)的長(zhǎng)度(從錯(cuò)誤報(bào)頭信息中提取)，容易通過(guò)主機(jī)過(guò)濾掉，例如看到異常的尺寸大小。
問(wèn)：我可以用LoRa設(shè)備發(fā)送或接受一個(gè)無(wú)限長(zhǎng)度的有效載荷數(shù)據(jù)包?
答：不可以，在LoRa模式中最大數(shù)據(jù)包長(zhǎng)度是256個(gè)字節(jié)。
問(wèn)：在LoRa模式中如何使用DIOx引腳?所有DIOx引腳都要連接到MCU嗎?
答：當(dāng)你開(kāi)始設(shè)計(jì)時(shí)，在LoRa和FSK兩種模式中檢查DIO映射。你可以在SX127x LoRa數(shù)據(jù)手冊(cè)中找到DIO映射信息。DIO沒(méi)有像通常(典型)MCU GPIO那樣的功能。有一些特殊的中斷信息(或時(shí)鐘輸出)指示事件或芯片狀態(tài)，這使得你的固件設(shè)計(jì)更易于實(shí)現(xiàn)。理論上，你可能不連接DIO引腳，那么就輪詢相關(guān)的寄存器知道狀態(tài)結(jié)果。當(dāng)然，我們建議連接DIO盡可能多地用作外部中斷功能，節(jié)省MCU的資源負(fù)載，可以很低功耗工作模式(當(dāng)打包發(fā)送或接受數(shù)據(jù)包時(shí)，MCU睡眠)。
問(wèn)：在LoRa模式中為什么有兩個(gè)RSSI寄存器?有什么區(qū)別?
答：在LoRa模式中，RegPktRssiValue和RegRssiValue 兩個(gè)寄存器都是有用的。RegPktRssiValue指的是數(shù)據(jù)包RSSI水平，RegRssiValue與在FSK模式(非LoRa模式)中的RSSI相似。如你所知，LoRa可以解調(diào)低于底噪聲(PktRssi 結(jié)果)的數(shù)據(jù)包，那么CurrentRssi等于或大于底噪聲。關(guān)于如何計(jì)算這兩個(gè)RSSI值更多信息，請(qǐng)參考Semtech API或最新的LoRa數(shù)據(jù)手冊(cè)。
答：SX127x芯片方案LoRa模塊設(shè)備在LoRa模式中有一個(gè)256字節(jié)的FIFO。理論上，所有的256字節(jié)都可以用于TX或RX。然而，用低數(shù)據(jù)速率配置，256字節(jié)有效載荷的傳輸時(shí)間將會(huì)很長(zhǎng)(幾秒或更長(zhǎng))，這對(duì)于抗衰落和高干擾環(huán)境是不好的。在大多數(shù)環(huán)境中這不是一個(gè)健壯的配置，因此建議如果想要一個(gè)使用低數(shù)據(jù)速率長(zhǎng)的有效載荷，那么數(shù)據(jù)包可以分成幾個(gè)短的數(shù)據(jù)包。
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